Nexperia IC Flip-Flop 1, 74LVC, Einseitig, Einseitig, SC-88, 6-Pin
- RS Best.-Nr.:
- 170-4861
- Herst. Teile-Nr.:
- 74LVC1G175GW,125
- Marke:
- Nexperia
Abbildung stellvertretend für Produktreihe
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Stück | Pro Stück | Pro Rolle* |
|---|---|---|
| 3000 + | CHF 0.061 | CHF 196.95 |
*Richtpreis
- RS Best.-Nr.:
- 170-4861
- Herst. Teile-Nr.:
- 74LVC1G175GW,125
- Marke:
- Nexperia
Technische Daten
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Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Nexperia | |
| Logikfamilie | 74LVC | |
| Produkt Typ | IC Flip-Flop | |
| Eingangstyp | Einseitig | |
| Ausgangstyp | Einseitig | |
| Taktfrequenz | 200MHz | |
| Polarität | Nicht invertierend | |
| Montageart | Oberfläche | |
| Gehäusegröße | SC-88 | |
| Minimale Versorgungsspannung | 1.65V | |
| Maximale Versorgungsspannung | 5.5V | |
| Pinanzahl | 6 | |
| Abzug Typ | Positiv-Flanke | |
| Flip-Flop-Typ | D-Flipflop | |
| Ausbreitungsverzögerungszeit max. bei Lastkapazität | 5.5ns | |
| Betriebstemperatur min. | -40°C | |
| Maximale Betriebstemperatur | 125°C | |
| Anzahl der Elemente pro Chip | 1 | |
| Normen/Zulassungen | No | |
| Länge | 2.2mm | |
| Höhe | 1mm | |
| Automobilstandard | Nein | |
| Alle auswählen | ||
|---|---|---|
Marke Nexperia | ||
Logikfamilie 74LVC | ||
Produkt Typ IC Flip-Flop | ||
Eingangstyp Einseitig | ||
Ausgangstyp Einseitig | ||
Taktfrequenz 200MHz | ||
Polarität Nicht invertierend | ||
Montageart Oberfläche | ||
Gehäusegröße SC-88 | ||
Minimale Versorgungsspannung 1.65V | ||
Maximale Versorgungsspannung 5.5V | ||
Pinanzahl 6 | ||
Abzug Typ Positiv-Flanke | ||
Flip-Flop-Typ D-Flipflop | ||
Ausbreitungsverzögerungszeit max. bei Lastkapazität 5.5ns | ||
Betriebstemperatur min. -40°C | ||
Maximale Betriebstemperatur 125°C | ||
Anzahl der Elemente pro Chip 1 | ||
Normen/Zulassungen No | ||
Länge 2.2mm | ||
Höhe 1mm | ||
Automobilstandard Nein | ||
- Ursprungsland:
- MY
Der 74LVC1G175 ist ein energiesparender Niederspannungs-D-Flipflop mit Auslösung über eine einzelne positive Flanke mit individuellem Dateneingang (D), Takteingang (CP), Master-Reset-Eingang (MR) und Q-Ausgang. Der Master-Reset (MR) ist ein asynchroner Active-LOW-Eingang und arbeitet unabhängig vom Takteingang. Informationen auf dem Dateneingang werden am Übergang von LOW zu HIGH des Taktimpulses auf den Ausgang Q übertragen. Für einen vorhersehbaren Betrieb muss der D-Eingang eine voreingestellte Zeit lang vor dem Taktübergang von HOW zu HIGH stabil sein.
Gemischte 5 V- und 3,3-V-Anwendungen
Verbesserte Signalintegrität mit integrierten Anschlusswiderständen
Hohe Störfestigkeit
Durchfluss-Anschlussbelegung für einfaches Layout
Großer Eingangsspannungsbereich
Geringe Ausbreitungsverzögerung
Überspannungstolerante Eingangsoptionen
Optionen mit integriertem Quellenanschlusswiderstand
Bus-Hold-Optionen
Frequenzteilung
Kontrollierte Verzögerungen
Schnittstelle zwischen asynchronen und synchronen Systemen
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