Altera FPGA (Field Programmable Gate Array) Arria V 362k Gates 362000 Zellen 362000 Einh. Spezieller DSP FBGA 1152-Pin
- RS Best.-Nr.:
- 830-3596P
- Herst. Teile-Nr.:
- 5AGXFB3H4F35I5N
- Marke:
- Altera
Nicht verfügbar
Wir haben dieses Produkt aus dem Sortiment genommen.
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- 5AGXFB3H4F35I5N
- Marke:
- Altera
Technische Daten
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Rechtliche Anforderungen
Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Altera | |
| Familie | Arria V | |
| Anzahl der Logik-Gates | 362k | |
| Anzahl der Logik-Zellen | 362000 | |
| Anzahl der Logik-Einheiten | 362000 | |
| Spezieller DSP | Ja | |
| Anzahl der Register | 547520 | |
| Anzahl der Multiplikatoren | 1045 (27 x 27), 2090 (18 x 18), 3135 (9 x 9) | |
| Montage-Typ | SMD | |
| Gehäusegröße | FBGA | |
| Pinanzahl | 1152 | |
| Anzahl der RAM Bits | 19358kbit | |
| Abmessungen | 35 x 35 x 2.1mm | |
| Höhe | 2.1mm | |
| Länge | 35mm | |
| Betriebstemperatur min. | -40 °C | |
| Arbeitsspannnung max. | 1,13 V | |
| Arbeitsspannnung min. | 1,07 V | |
| Breite | 35mm | |
| Betriebstemperatur max. | +100° C | |
| Alle auswählen | ||
|---|---|---|
Marke Altera | ||
Familie Arria V | ||
Anzahl der Logik-Gates 362k | ||
Anzahl der Logik-Zellen 362000 | ||
Anzahl der Logik-Einheiten 362000 | ||
Spezieller DSP Ja | ||
Anzahl der Register 547520 | ||
Anzahl der Multiplikatoren 1045 (27 x 27), 2090 (18 x 18), 3135 (9 x 9) | ||
Montage-Typ SMD | ||
Gehäusegröße FBGA | ||
Pinanzahl 1152 | ||
Anzahl der RAM Bits 19358kbit | ||
Abmessungen 35 x 35 x 2.1mm | ||
Höhe 2.1mm | ||
Länge 35mm | ||
Betriebstemperatur min. -40 °C | ||
Arbeitsspannnung max. 1,13 V | ||
Arbeitsspannnung min. 1,07 V | ||
Breite 35mm | ||
Betriebstemperatur max. +100° C | ||
Arria V GX FPGA mit 6 Gbit/s Transceiver, Altera
Diese Geräte bieten Bandbreite, Kosten und Leistungsstufen, die für hohe Datenmengen und Signalverarbeitungsanwendungen optimiert sind
Ein FPGA ist ein Halbleitergerät, die aus einer Matrix aus konfigurierbaren Logikblöcke (CLBs) bestehen und durch programmierbare Verbindungen miteinander verbunden sind. Der Benutzer bestimmt diese Verbindungen durch die Programmierung eines SRAM. Ein CLB kann einfach (UND-, ODER-Gatter usw.) oder komplex (ein RAM-Block) sein. Der FPGA ermöglicht Designänderungen, auch nachdem das Gerät auf eine Leiterplatte gelötet wurde.