Toshiba Logikgatter, 2-Elem., UND, 74HC, Puffer, CMOS, 5.2 mA, 14-Pin, SOIC, 4
- RS Best.-Nr.:
- 171-3385
- Herst. Teile-Nr.:
- 74HC21D
- Marke:
- Toshiba
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- 171-3385
- Herst. Teile-Nr.:
- 74HC21D
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- Toshiba
Technische Daten
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Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Toshiba | |
| Produkt Typ | Logikgatter | |
| Anzahl der Elemente | 2 | |
| Logikfunktion | UND | |
| Logikfamilie | 74HC | |
| Ausgangstyp | Puffer, CMOS | |
| Ausgangsstrom Low-Pegel max. | 5.2 mA | |
| Pinanzahl | 14 | |
| Gehäusegröße | SOIC | |
| Anzahl der Eingänge pro Gate | 4 | |
| Schmitt-Trigger-Eingang | Nein | |
| Automobilstandard | Nein | |
| Höhe | 1.38 mm | |
| Eingangstyp | CMOS | |
| Länge | 8.95 mm | |
| Ausgangsstrom High-Pegel max. | -5.2 mA | |
| Maximale Betriebstemperatur | 85 °C | |
| Ausbreitungsverzögerungszeit max. bei Lastkapazität | 25 ns | |
| Maximale Versorgungsspannung | 6 V | |
| Betriebstemperatur min. | -40 °C | |
| Minimale Versorgungsspannung | 2 V | |
| Montageart | Oberfläche | |
| Serie | 74HC | |
| Normen/Zulassungen | No | |
| Breite | 3.9 mm | |
| Alle auswählen | ||
|---|---|---|
Marke Toshiba | ||
Produkt Typ Logikgatter | ||
Anzahl der Elemente 2 | ||
Logikfunktion UND | ||
Logikfamilie 74HC | ||
Ausgangstyp Puffer, CMOS | ||
Ausgangsstrom Low-Pegel max. 5.2 mA | ||
Pinanzahl 14 | ||
Gehäusegröße SOIC | ||
Anzahl der Eingänge pro Gate 4 | ||
Schmitt-Trigger-Eingang Nein | ||
Automobilstandard Nein | ||
Höhe 1.38 mm | ||
Eingangstyp CMOS | ||
Länge 8.95 mm | ||
Ausgangsstrom High-Pegel max. -5.2 mA | ||
Maximale Betriebstemperatur 85 °C | ||
Ausbreitungsverzögerungszeit max. bei Lastkapazität 25 ns | ||
Maximale Versorgungsspannung 6 V | ||
Betriebstemperatur min. -40 °C | ||
Minimale Versorgungsspannung 2 V | ||
Montageart Oberfläche | ||
Serie 74HC | ||
Normen/Zulassungen No | ||
Breite 3.9 mm | ||
The 74HC21D is a high speed CMOS 4-INPUT AND GATE fabricated with silicon gate C2MOS technology. It achieves the high speed operation similar to equivalent LSTTL while maintaining the CMOS low power dissipation. The internal circuit is composed of 4 stages including buffer an output, which provide high noise immunity and stable output. All inputs are equipped with protection circuits against static discharge or transient excess voltage
High speed: tpd = 10 ns (typ.) at VCC = 5 V
Low power dissipation: ICC = 1.0 μA (max) Ta = 25
Balanced propagation delays: tPLH ≈ tPHL
Wide operating voltage range: VCC(opr) = 2.0 to 6.0 V
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