Nexperia IC Flip-Flop 2, 74LVC, D-Typ, Einseitig, TSSOP, 14-Pin
- RS Best.-Nr.:
- 170-4845
- Herst. Teile-Nr.:
- 74LVC74APW,118
- Marke:
- Nexperia
Abbildung stellvertretend für Produktreihe
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|---|---|---|
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- RS Best.-Nr.:
- 170-4845
- Herst. Teile-Nr.:
- 74LVC74APW,118
- Marke:
- Nexperia
Technische Daten
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Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Nexperia | |
| Logikfamilie | 74LVC | |
| Produkt Typ | IC Flip-Flop | |
| Eingangstyp | Einseitig | |
| Ausgangstyp | D-Typ | |
| Taktfrequenz | 120MHz | |
| Polarität | Invertierer, Nicht invertierend | |
| Montageart | Oberfläche | |
| Minimale Versorgungsspannung | 1.65V | |
| Gehäusegröße | TSSOP | |
| Pinanzahl | 14 | |
| Maximale Versorgungsspannung | 3.6V | |
| Ausbreitungsverzögerungszeit max. bei Lastkapazität | 6.5ns | |
| Betriebstemperatur min. | -40°C | |
| Flip-Flop-Typ | D-Flipflop | |
| Abzug Typ | Positiv-Flanke | |
| Anzahl der Elemente pro Chip | 2 | |
| Maximale Betriebstemperatur | 125°C | |
| Länge | 5.1mm | |
| Höhe | 0.95mm | |
| Normen/Zulassungen | No | |
| Automobilstandard | Nein | |
| Alle auswählen | ||
|---|---|---|
Marke Nexperia | ||
Logikfamilie 74LVC | ||
Produkt Typ IC Flip-Flop | ||
Eingangstyp Einseitig | ||
Ausgangstyp D-Typ | ||
Taktfrequenz 120MHz | ||
Polarität Invertierer, Nicht invertierend | ||
Montageart Oberfläche | ||
Minimale Versorgungsspannung 1.65V | ||
Gehäusegröße TSSOP | ||
Pinanzahl 14 | ||
Maximale Versorgungsspannung 3.6V | ||
Ausbreitungsverzögerungszeit max. bei Lastkapazität 6.5ns | ||
Betriebstemperatur min. -40°C | ||
Flip-Flop-Typ D-Flipflop | ||
Abzug Typ Positiv-Flanke | ||
Anzahl der Elemente pro Chip 2 | ||
Maximale Betriebstemperatur 125°C | ||
Länge 5.1mm | ||
Höhe 0.95mm | ||
Normen/Zulassungen No | ||
Automobilstandard Nein | ||
- Ursprungsland:
- CN
Der 74LVC74A ist ein an zwei Kanten ausgelöster D-Flipflop mit individuellen Dateneingängen (nD), Takteingängen (nCP), Set-Eingängen (nSD) und (nRD) sowie den komplementären Ausgängen nQ und nQ. Set und Reset sind asynchrone Active-LOW-Eingänge und funktionieren unabhängig vom Takteingang. Informationen auf dem Dateneingang werden am Übergang von LOW zu HIGH des Taktimpulses auf den Ausgang nQ übertragen. Für einen vorhersehbaren Betrieb müssen die nD-Eingänge eine voreingestellte Zeit lang vor dem Taktübergang von LOW zu HIGH stabil sein.
Gemischte 5 V- und 3,3-V-Anwendungen
Verbesserte Signalintegrität mit integrierten Anschlusswiderständen
Hohe Störfestigkeit
Durchfluss-Anschlussbelegung für einfaches Layout
Großer Eingangsspannungsbereich
Geringe Ausbreitungsverzögerung
Überspannungstolerante Eingangsoptionen
Optionen mit integriertem Quellenanschlusswiderstand
Bus-Hold-Optionen
Frequenzteilung
Kontrollierte Verzögerungen
Schnittstelle zwischen asynchronen und synchronen Systemen
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