Nexperia IC Flip-Flop 1, 74LVC, D-Typ, Einseitig, TSSOP, 20-Pin
- RS Best.-Nr.:
- 170-4863
- Herst. Teile-Nr.:
- 74LVC273PW,118
- Marke:
- Nexperia
Abbildung stellvertretend für Produktreihe
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|---|---|---|
| 2500 + | CHF.0.273 | CHF.689.33 |
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- RS Best.-Nr.:
- 170-4863
- Herst. Teile-Nr.:
- 74LVC273PW,118
- Marke:
- Nexperia
Technische Daten
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Produktdetails
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Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Nexperia | |
| Produkt Typ | IC Flip-Flop | |
| Logikfamilie | 74LVC | |
| Eingangstyp | Einseitig | |
| Ausgangstyp | D-Typ | |
| Taktfrequenz | 150MHz | |
| Polarität | Nicht invertierend | |
| Montageart | Oberfläche | |
| Minimale Versorgungsspannung | 1.65V | |
| Gehäusegröße | TSSOP | |
| Maximale Versorgungsspannung | 3.6V | |
| Pinanzahl | 20 | |
| Abzug Typ | Positiv-Flanke | |
| Ausbreitungsverzögerungszeit max. bei Lastkapazität | 10.5ns | |
| Flip-Flop-Typ | D-Flipflop | |
| Betriebstemperatur min. | -40°C | |
| Anzahl der Elemente pro Chip | 1 | |
| Maximale Betriebstemperatur | 125°C | |
| Normen/Zulassungen | No | |
| Höhe | 0.95mm | |
| Länge | 6.6mm | |
| Automobilstandard | Nein | |
| Alle auswählen | ||
|---|---|---|
Marke Nexperia | ||
Produkt Typ IC Flip-Flop | ||
Logikfamilie 74LVC | ||
Eingangstyp Einseitig | ||
Ausgangstyp D-Typ | ||
Taktfrequenz 150MHz | ||
Polarität Nicht invertierend | ||
Montageart Oberfläche | ||
Minimale Versorgungsspannung 1.65V | ||
Gehäusegröße TSSOP | ||
Maximale Versorgungsspannung 3.6V | ||
Pinanzahl 20 | ||
Abzug Typ Positiv-Flanke | ||
Ausbreitungsverzögerungszeit max. bei Lastkapazität 10.5ns | ||
Flip-Flop-Typ D-Flipflop | ||
Betriebstemperatur min. -40°C | ||
Anzahl der Elemente pro Chip 1 | ||
Maximale Betriebstemperatur 125°C | ||
Normen/Zulassungen No | ||
Höhe 0.95mm | ||
Länge 6.6mm | ||
Automobilstandard Nein | ||
- Ursprungsland:
- CN
Das 74LVC273 besitzt acht D-Flipflops mit Kantenauslösung mit individuellen Dn-Eingängen und Qn-Ausgängen. Die gemeinsamen Takt- (CP) und Master-Reset-(MR-)Eingänge führen das Laden und Reset (Löschen) aller Flipflops gleichzeitig durch. Der Zustand jedes Dn-Eingangs eine voreingestellt Zeit vor dem Taktübergang von LOW zu HIGH wird auf den entsprechenden Ausgang (Qn) des Flipflop übertragen. Alle Ausgänge werden unabhängig von Takt- oder Dateneingänge durch einen LOW-Spannungspegel am MR-Eingang auf LOW gesetzt.
Gemischte 5 V- und 3,3-V-Anwendungen
Verbesserte Signalintegrität mit integrierten Anschlusswiderständen
Hohe Störfestigkeit
Durchfluss-Anschlussbelegung für einfaches Layout
Großer Eingangsspannungsbereich
Geringe Ausbreitungsverzögerung
Überspannungstolerante Eingangsoptionen
Optionen mit integriertem Quellenanschlusswiderstand
Bus-Hold-Optionen
Frequenzteilung
Kontrollierte Verzögerungen
Schnittstelle zwischen asynchronen und synchronen Systemen
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