Micron SDRAM 1 GB SMD 16 Bits/Wort 16 bit TFBGA 96-Pin
- RS Best.-Nr.:
- 696-928
- Herst. Teile-Nr.:
- MT41K64M16TW-107 IT:J
- Marke:
- Micron
Abbildung stellvertretend für Produktreihe
Zwischensumme (1 Stück)*
CHF.2.424
Auf Lager
- 24 Einheit(en) versandfertig von einem anderen Standort
- Zusätzlich 50 Einheit(en) mit Versand ab 24. Dezember 2026
Sie benötigen mehr? Benötigte Menge eingeben und auf „Lieferverfügbarkeit überprüfen“ klicken.
Stück | Pro Stück |
|---|---|
| 1 + | CHF.2.42 |
*Richtpreis
- RS Best.-Nr.:
- 696-928
- Herst. Teile-Nr.:
- MT41K64M16TW-107 IT:J
- Marke:
- Micron
Technische Daten
Mehr Infos und technische Dokumente
Rechtliche Anforderungen
Produktdetails
Finden Sie ähnliche Produkte, indem Sie ein oder mehrere Eigenschaften auswählen.
Alle auswählen | Eigenschaft | Wert |
|---|---|---|
| Marke | Micron | |
| Speicher Größe | 1GB | |
| Produkt Typ | SDRAM | |
| Datenbus-Breite | 16bit | |
| Taktfrequenz max. | 933MHz | |
| Anzahl der Bits pro Wort | 16 | |
| Montageart | SMD | |
| Gehäusegröße | TFBGA | |
| Pinanzahl | 96 | |
| Betriebstemperatur min. | -40°C | |
| Maximale Betriebstemperatur | 95°C | |
| Höhe | 1.2mm | |
| Breite | 8mm | |
| Normen/Zulassungen | RoHS | |
| Serie | MT41K | |
| Länge | 14mm | |
| Minimale Versorgungsspannung | 1.283V | |
| Maximale Versorgungsspannung | 1.45V | |
| Automobilstandard | Nein | |
| Alle auswählen | ||
|---|---|---|
Marke Micron | ||
Speicher Größe 1GB | ||
Produkt Typ SDRAM | ||
Datenbus-Breite 16bit | ||
Taktfrequenz max. 933MHz | ||
Anzahl der Bits pro Wort 16 | ||
Montageart SMD | ||
Gehäusegröße TFBGA | ||
Pinanzahl 96 | ||
Betriebstemperatur min. -40°C | ||
Maximale Betriebstemperatur 95°C | ||
Höhe 1.2mm | ||
Breite 8mm | ||
Normen/Zulassungen RoHS | ||
Serie MT41K | ||
Länge 14mm | ||
Minimale Versorgungsspannung 1.283V | ||
Maximale Versorgungsspannung 1.45V | ||
Automobilstandard Nein | ||
- Ursprungsland:
- TW
Der Micron DDR3 SDRAM verwendet eine Architektur mit doppelter Datenrate, um einen Hochgeschwindigkeitsbetrieb zu erreichen. Die Architektur mit doppelter Datenrate ist eine 8-n-Prefetch-Architektur mit einer Schnittstelle, die für die Übertragung von zwei Datenwörtern pro Taktzyklus an den I/O-Pins entwickelt wurde. Ein einzelner Lese- oder Schreibvorgang für den DDR3 SDRAM besteht effektiv aus einer einzigen 8-n-Bit-Datenübertragung mit vier Taktzyklen am internen DRAM-Kern und acht entsprechenden n-bit-Datenübertragungen mit einem halben Taktzyklus an den I/O-Pins.
Selbstwiederholungstemperatur
Automatische Selbstaktualisierung
Mehrzweckregister
RoHS-Konformität
